UART模块通过2个64位深的先进先出堆栈对处理器接收到的字符数据执行从串行到并行的转换，并对处理器传输的字符数据执行从并行到串行的转换。SPI是一个双向的3路接口，用于为从或向外部设备进行的数据传输提供一个3路串行接口。这个串口完全由MCU存储器接口控制。它是基于一个循环移位寄存器的，允许2种传输模式，即并行输入、串行输出和串行输入、并行输出。54703提供36个通用I/O口（GPIO），它们可以通过内部寄存器配置成读或写模式。这些GPIO被分成2组：GPIO（19：0）和KBGPIO（15：0）。KBGPIO是键盘GPIO引脚，它们当中有些具有内部上拉电阻，但其进行的操作与GPIO（19：0）引脚类似。主I2C接口模块为MCU子系统总线和I2C引脚之间提供了1个接口，它允许MCU控制与I2C引脚连接的外部设备。I2C接口实际上一是个并行到串行和串行到并行的转换器。从MCU接收的并行数据必须在I2C总线上转换为适当的串行格式传输给外部设备，从I2C总线上接收的串行数据必须转换为适当的并行格式传输给MCU。5470 MCU子系统包括3个16位的定时器，它们可被配置为“自动加载”或“倒计数器0并停止”2种模式。当定时器计数到0时，向MCU产生1个中断。定时器0可被配置为看门狗定时器或通用定时器，定时器1和时器2为通用定时器。看门狗定时器在倒计数为0时复位MCU子系统，以避免用户程序被死循环阻塞而使程序失去控制。MCU子系统的中断控制器对MCU子系统的16个中断源（IRQ0～15）进行优先权和屏蔽控制。它还可以将这些中断划分为MCU的2种中断输入：nIRQ(低优先级中断请求)和nFIQ(快速中断请求)。它既可以从内部模块也可以从外部的芯片环境中接收中断。外部中断可以通过GPIO和/或KBGPIO引脚提供。
（4）MCU的省电模式
MCU及其子系统外围可以通过设置CLKM_BER和WAKEUP_REG2个寄存器的适当位被关闭和唤醒。在MCU关闭之间，由软件来负责将ARM_CLOCK设置为旁路或低频模式。由来自某外围的第1个中断将MCU唤醒。
（5）MCU外部时钟管理
5470器件由外围时钟输入信号REFCLK提供时钟定时。5470 REFCLK输入不提供时钟振荡器。所以它必须由遇到VIH和VIL请求的方形波输入信号来驱动。DSP和MCU子系统的时钟都是通过使用锁相环由REFCLK衍生的。复位或加电之后，2个子系统中各自CLKMD寄存器内容由各自锁相环上可编程内部端口的状态决定。对于MCU子系统，这些内部端口是硬连线的，所以缺省模式下的可编程性能是不可用的。对于DSP子系统，DSP PLL的可编程内部端口与寄存器DSP_REG的输出相连接，此寄存器由RISC处理器控制。这样在MCU子系统的控制下，DSP PLL的缺省值则允许为可编程的。图3为时钟管理模块框图。
MCU子系统有3种运行模式：PLL（正常情况下）模式、DIV模式和省电模式。在省电模式下，输入时钟频率被一个大数（512～1023）相除。当把MCU子系统时钟模块配置为省电运行模式时，如果使用一个小于512的值做除数，则将导致时钟停止。与DSP时钟相似，MCU子系统时钟也是由输入时钟（REFCLK）的扩展版本衍生的。RISC使用的PLL与DSP PLL一样，因此，RISC处理器使用与DSP相同的最小输入时钟频率限制和扩缩值（scalingvalue）。
（6）初始化
RESET是复位DSP和MCU子系统的主复位输入。RESET_OUT信号在MCU的控制下可用于复位外部设备。当MCU子系统被复位时，M摘要：主要介绍美国TI公司最新推出的定点数字信号处理器TMS320VC5470的结构、功能及特性。对集成到该器件中的TMS320C54x数字信号处理器和ARM7TDMI RISC MCU及其两者的连接分别作了介绍。对选用TMS320VC5470作为数字信号处理器构建嵌入式系统有一定的参考价值。
关键词：TMS320VC5470 DSP MCU TMS320C54x ARM7TDMI
引言
TMS320VC5470（简称5470）是集成了基于TMS320C54x体系结构的DSP子系统和基于ARM7TDMI核的RISC微控制器子系统的CPU定点数字信号处理器。它与以前的器件相比，提高了速度、降低了功耗，并且在很大程度上提高了编程灵活性，有利于对产品的软硬件升级，用于实现具有特殊功能的产品。通过合理安排软硬件资源，还可以节省投资，加速上市时间。
1 TMS320VC5470特性及功能框图
*集成了1个TMS320C54x体系结构的DSP和1个ARM7TDMI RISC MCU的双CPU处理器；
*带有72K×16位集成SRAM的16位低功耗DSP，速度可高达100MHz；
*用于DSP和MCU子系统的先进电源管理和低功耗模式；
*集成的DSP子系统外围，包括2个高速的全双工多通道缓冲串口McBSPs，使DSP核可以与编解码器（CODEC）直接接口；具有6个独立通道的DMA控制器；ARM端接口（port interface）为MCU子系统和DSP子系统的CPU之间进行有效的信息交换提供了2K×16位的共享存储器接口；外存储器接口EMIF（External Memory Interface）；可以将外部总线周期扩展到14个机器周期的软件可编程等待状态生器；1个用于控制功能的软件可编程的硬件定时器；可编程的锁相环PLL时钟发生器。
*带有16K字节集成SRAM和仿真性能增强型的ARM7TDMI RISC微控制器核，使运行速度可高达47.5MHz；
*集成的MCU子系统外围，包括通用异步收发器UART、支持SIR协议的UART/IrDA接口、串行外围接SPI、36个通用I/O引脚、I2C接口、2个通用定时器、1个看门狗定时器、中断处理器、支持Flash/SRAM/SDRAM/ROM的外部存储接口、对MCU外围灵活的时钟管理、可编程的锁相环时钟发生器。
*基于片上扫描的仿真逻辑，DSP和MCU核的IEEE标准1149.1+（JTAG）边界扫描逻辑；
*支持DSP和MCU核的基于扫描的仿真。
图1为TMS320VC5470器件的功能框图。此器件由DSP和MCU 2个子系统构成。
2 DSP子系统功能介绍
DSP子系统是基于TMS320C54x、片上存储器和外围的，并且与其它的C54x产品代码兼容。DSP子系统包括DSP CPU核、用于产生时钟的锁相环、与外部并行设备连接的接口、1个定时器、72K字的RAM、2个多通道缓冲串口、1个允许MCU访问DSP子系统某部分存储器映射的接口以及1个JTAG接口。
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